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该工作提出并描述了一种面向硬件的量子计算范式——量子时序电路（QSC），其核心构建单元是一种称为“量子晶体管”的创新基础元件。与传统基于量子比特的架构不同，量子时序电路采用对称性保护的拓扑结结构，通过通道-状态对偶性将量子门编码为Choi态，并利用体测量激活这些门操作，同时采用纠缠比特（ebits）实现经典时序电路中反馈环路的量子功能类比。该框架建立了一个天然包含存储功能和时序特性的通用量子计算模型，对现有组合式量子电路模型形成了重要补充。该研究推进了通向量子冯·诺伊曼架构的概念桥梁，凸显了混合模块化设计原则在发展大规模集成量子信息处理器方面的潜力。