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该研究团队提出了一种基于最小有色码（Earl Campbell，2016）的早期容错量子计算机架构。该架构实现了由X基和Z基下的单量子比特测量与制备、单量子比特Hadamard（H）门以及三量子比特受控-受控-Z（CCZ）门组成的通用逻辑门集合。通过[[4,2,2]]（二维）与[[8,3,2]]（三维）错误检测有色码之间的量子态隐形传态，该工作可利用这些编码所具有的横向H门和CCZ门。因此，核心优化目标在于最小化逻辑量子隐形传态操作次数，而非逻辑量子非Clifford门数量。为帮助硬件开发者评估该架构，研究人员还提供了专门用于测试该架构所表达逻辑量子电路的实验协议。